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文件名称:芯片设计——CMOS模拟集成电路版图设计与验证:基于Cadence IC 6.1.7 第3版 课件 第1、2章 Cadence Virtuoso6.1.7版图设计工具;Siemens EDA Calibre版图验证工具.pptx
文件大小:18.22 MB
总页数:252 页
更新时间:2026-02-27
总字数:约3.64千字
文档摘要

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